课题组低抖动时钟芯片研究成果在MWTL发表
发布时间：2026-09-06
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课题组低抖动时钟芯片研究成果在MWTL发表。论文展示了一种基于环形振荡器的低抖动注入锁定锁相环时钟芯片，该结构利用同步注入锁定和频率追踪结构，有效解决传统注入锁定PLL中的相位和摆率失配问题，同时避免了复杂的相位校准。芯片在28nm CMOS工艺设计实现，时钟抖动161.9 fs, 杂散-60.2 dBc, FoMjitter = -246.1dB。
论文第一作者：高肈杉（硕士研究生）